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简谈SDR、DDR、QDR存储器的比较
大家好，又到了每日学习的时间了，今天咱们来聊一聊SDR、DDR、QDR存储器。首先先简单的了解一下，然后在做一下比较。 SDR：Single Data Rate, 单倍速率 DDR：Dual Data Rate， 双倍速率 QDR：Quad Data Rate， 四倍速率 DRAM：Dynamic RAM， 动态随机存储器， 每隔一段时间就要刷新一次数据才能够保存数据 SRAM：Static...
View ArticleUltraScale DDR4 — 封装晶片速度表中 tCK(avg) 的 JEDEC 规范升级会影响 DDR4-2133 及更快速度级器件的 CL 和...
描述找到问题的版本: DDR4 v2.2 (Rev. 1)解决问题的版本： 查看 (Xilinx Answer 69035)在最新版 JEDEC DDR4 标准（2017 年 6 月发布的 JESD79-4B）中，更高速度级器件的 tCK(avg) 截止周期已从 0.938ns 变成了 0.937ns。总的来说，这影响了 DDR4-2133、DDR4-2400、DDR4-2666、DDR4-2933...
View ArticleZynq-7000 SoC 的设计咨询、APU — L2 高速缓存运行需要编程 slcr.L2C_RAM 寄存器
描述对于正确的 L2 高速缓存运行，用户代码必须在启用 L2 高速缓存之前，将 slcr.L2C_RAM 寄存器（地址 0xF800_0A1C）编程为 0x0002_0202 的值。重置的值 (0x0001_0101) 可能会导致 L2 高速缓存返回无效数据，这种情况很少发生。
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Xilinx FPGA暑期实习生集结号
依元素科技吹响2018 Xilinx FPGA暑期实习集结号，通过实际项目开发过程，提升技术能力，积累FPGA开发经验。提供FPGA专业实习岗位+专业培训机会+项目实战，将实习生打造成为具备工程实践的研发思维、创新能力的新时代软硬件协同设计的复合型人才。弹性工作时间 灵活工作地点实习地点：南京江北新区集成电路产业服务中心简历请发送到...
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一文读懂目标检测AI算法：R-CNN，faster R-CNN，yolo，SSD，yoloV2
1 引言深度学习目前已经应用到了各个领域，应用场景大体分为三类：物体识别，目标检测，自然语言处理。上文我们对物体识别领域的技术方案，也就是CNN进行了详细的分析，对LeNet-5 AlexNet VGG Inception ResNet...
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波特率/符号速率/传码率/数据速率/比特率/吞吐率/带宽区别
工作中我们经常碰到这几个概念，由于这几个概念意思很接近，给我们带来很大的困惑，有时还把他们搞混，今天我们就来谈谈这几个概念，希望对大家理解他们能有所帮助。在讲述这几个概念之前，我们先看看信号一般是如何在信道上传输的。如上图所述，虽然我们只想传输bit0~bit7，但由于通信机制的限制，我们必须在bit0之前加上start bit，在bit7之后加上stop...
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SDSoC开发流程探秘：简单背后的不简单
在上SDSoC系列文章的上一篇中，我们已经介绍了如何在SDSoC中构建硬件和软件平台，并使用SDSPFM工具生成客户应用开发平台（参见《SDSoC开发起步：构建硬件和软件平台》）。如果你已经完成了上述工作，恭喜你——现在你可以正式“起步”开始基于SDSoC在Zynq SoC上开发自己的应用了！阅读全文
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【PPT下载】Vivado专家系列：高速时序收敛的技巧
赛灵思“Vivado专家系列”研讨会将由来自赛灵思Vivado开发者及资深技术支持团队成员为您带来包括技术分享、设计方法学、设计技巧等内容，以帮助用户快速提高其基于FPGA 的设计效率。此次研讨会为该系列的第一期，旨在深入剖析Vivado高速时序收敛技术。另外我们还将总结高速设计面临的挑战，介绍设计分析、设计向导以及设计复杂性和拥塞的分析方法。
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PLC/HMI/运动控制
Xilinx FPGA 和 SoC 支持新一代集成式 HMI，其采用丰富的图形用户界面，包括 PLC 和运动控制功能，而且能连接到任何工业网络。可编程逻辑控制器 (PLC) 及人机接口 (HMI) 是生产现场的中央器件，不仅可控制各项功能，而且还可由工作人员做决策。PLC 和 HMI 在尺寸方面的发展是背道而驰的，因为前者利用底层技术不断缩小尺寸，后者通过同样的技术转换扩大尺寸。这些通过...
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通过任何工业网络实现可靠的通信
Xilinx 器件可在一个平台上通过多协议 IP 解决方案及通用架构实现无与伦比的高性能。Xilinx FPGA、Zynq®-7000 SoC 和 Zynq UltraScale+™ MPSoC 都是工业网络与通信的理想选择。特定协议 MAC 层可在 FPGA...
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简谈 FPGA 片内资源
作者：luhui大家好，到了每日学习的时间了。今天我们来聊一聊FPGA的片内资源相关知识。主流的FPGA仍是基于查找表技术的，已经远远超出了先前版本的基本性能，并且整合了常用功能（如RAM、DCM和DSP）的硬核（ASIC型）模块。如图所示，FPGA芯片主要由7部分组成，分别为：可编程输入输出单元（IOB）、基本可编程逻辑单元（CLB）、完整的时钟管理（DCM）、嵌入式块RAM、丰富的布线资源、内嵌...
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带你梳理下ARM代码编译与链接调试的工作流程
梳理下下ARM代码编译链接的工作流程，以及过程中需要的相关概念信息，不具体关注编译链接的具体命令。一、编译过程编译过程就是把源代码编译生成目标代码的过程。而采用ARM编译命令，可以将源代码编译成带有ELF格式的目标文件。除了编译命令可以选择相应的编译选项之外，源代码中的pragmas以及特别的关键字也会对编译过程/结果产生一定影响。1、makefile文件Makefiile类似一个脚本文件，这个文件...
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Vivado常用综合选项的设置
-flatten_hierarchy full:综合时将原始设计打平，只保留顶层层次，执行边界优化 none:综合时完全保留原始设计层次，不执行边界优化...
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下载Xilinx设计工具最好的方法
作者：Satyam你有没有注意到在Netflix流媒体视频播放时，有时候视频模糊，然后很快恢复到高质量？ 你知道Netflix在这几秒之间做了什么吗？ 与自适应比特率流类似，它不断扫描最佳的可以更快地传送数据包的CDN（内容传送网络）服务器。 Netflix可能已经掌握了这种技术，但是无中断的传输大量的数据的技术已经出现很多年了。例如，在Xilinx,我们使用了带有这样特性的Web...
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Xilinx专业音频系统解决方案
Xilinx FPGA 可提供卓越的数字信号处理 (DSP) 性能，能够满足音频处理、接口、压缩、嵌入和转换等方面的需求。FPGA 架构所具有的内在并行性意味着音频的许多通道都可以使用极其高效的资源合并在一起处理。Xilinx FPGA 的高性能可提供出色的音频性能和质量，能够充分满足大多数应用的需求。 Xilinx 提供架构，作为 ASSP 和 DSP 的经济高效、灵活的替代品；Xilinx...
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当FPGA越来越像SoC，FPGA跟ASIC还有啥区别
随着处理器被添加到传统FPGA中，可编程性被添加到ASIC中，FPGA和ASIC的分界线日益模糊。FPGA变得比之前更加流行了。现在的FPGA不再只是查找表（LUT）和寄存器的简单组合了，它已经成为系统探索的架构，以及验证未来ASIC设计架构的桥梁。从基本的可编程逻辑器件到复杂的SoC器件，当今的FPGA家族阵营极其庞大。在包括汽车和其它应用的AI、企业网络、航空航天、国防和工业自动化等各种应用领域...
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Xilinx OLOGIC 资源
OLOGIC块在FPGA内的位置紧挨着IOB，其作用是FPGA通过IOB发送数据到器件外部的专用同步块。OLOGIC 资源的类型有OLOGIC2(位于HP I/O banks)和OLOGIC2(位于HR I/O...
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如何在SDK系统调试器中设置远程调试？
赛灵思SDK允许您使用远程主机中的赛灵思硬件服务器来调试远程目标设备。硬件服务器在通过JTAG连接目标的远程主机中，从XSCT控制台启动Xilinx hw_server。SDK目标连接在硬件服务器中添加新的目标配置。使用主机名（或IP地址）以及在远程主机中设置硬件服务器时使用的端口。阅读全文
View ArticleZynq-7000 SoC, APU - 始终被处理器写入的一级缓存行一致性请求可能出现服务拒绝
描述一个针对相同 L1 高速缓存线路执行连续写入流的处理器可能会阻止另一个一致的处理器或 ACP 访问相同的高速缓存线路。
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![[LoliHouse] Princess-Session Orchestra - 15 [WebRip 1080p HEVC-10bit...](http://s2.loli.net/2025/04/09/QO618K72ytGZmDJ.webp)
